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Docente

Eduardo Wanderley

Possui graduação em Engenharia Elétrica pela Universidade Federal do Rio Grande do Norte (1993), mestrado em Engenharia Eletrônica e Computação pelo Instituto Tecnológico de Aeronáutica (1995) e doutorado em Ciência da Computação pela Universidade Estadual de Campinas (2004) e Pós-doutorado em eletrônica na Universidade da Bretanha do Sul -França (2007) e Teólogo pelo Centro Universitário Claretiano (2018). Atualmente é professor do Instituto Federal de Educação, Ciência e Tecnologia do Rio Grande do Norte. Tem experiência na área de Ciência da Computação, com ênfase em Arquitetura de Sistemas de Computação, atuando principalmente nos seguintes temas: arquitetura de computadores, compressão de código e arquiteturas reconfiguráveis.

Campus:
CNAT
Disciplina:
Informática
E-mail:
eduardo.wanderley@ifrn.edu.br
Lattes:
http://lattes.cnpq.br/1388009053895818

  • Graduação em Teologia

    Institução/Ano:
    Claretiano Centro Universitário (2015 - 2018)

  • Pós-Doutorado em

    Institução/Ano:
    Université de Bretagne Sud, IUT de Lorient (2006 - 2007)

  • Doutorado em Ciência da Computação

    Institução/Ano:
    Universidade Estadual de Campinas (2001 - 2004)
    Título:
    Compressão de Código Baseada em Multi-Profile
    Orientador:
    Paulo Cesar Centoducatte

  • Mestrado em Engenharia Eletrônica e Computação

    Institução/Ano:
    Instituto Tecnológico de Aeronáutica (1993 - 1995)
    Título:
    Uma arquitetura RISC para processamento digital de sinais
    Orientador:
    Osamu Saotome

  • Graduação em Engenharia Elétrica

    Institução/Ano:
    Universidade Federal do Rio Grande do Norte (1989 - 1993)
  • Ciências Exatas e da Terra – Ciência da Computação – Sistemas de Computação – Arquitetura de Sistemas de Computação
  • Ciências Exatas e da Terra – Ciência da Computação – Sistemas de Computação – Hardware
  • Ciências Exatas e da Terra – Ciência da Computação – Sistemas de Computação – Software Básico
  • Ciências Exatas e da Terra – Ciência da Computação – Metodologia e Técnicas da Computação – Sistemas de Informação

  • A security approach for off-chip memory in embedded microprocessor systems

    Microprocessors and Microsystems, 2009

  • Bus Decryption Overhead Minimization with Code Compression

    IEEE Southern Conference on Programmable Logic, 2007

  • A Code Compression Method With Confidentiality and Integrity Checking

    International Conference on Embedded Systems and Applications, 2007

  • Low latency solution for confidentiality and integrity checking in embedded systems with off-chip memory

    Reconfigurable Communication-centric SoC, ReCoSoC, 2007

  • An Instruction Based Compression method with Encryption and Integrity Checking

    Reconfigurable Communication-centric SoC, ReCoSoC07, 2007

  • A Code Compression Method to Cope with Security Hardware Overheads

    International Symposium on Computer Architecture and High Performance Computing, 2007

  • Dual Selective Code Compression

    XXXII Conferencia Latino Americana em Informatica, 2006

  • Design of a Decompressor Engine on a SPARC Processor

    Symposium on Integrated circuits and system design, 2005

  • Exploiting the AreaXPerformance trade-off with code Compression

    In The Proceeding of the 2005 International Symposium on System-on-Chip, 2005

  • Compressão de Código PDC: um Estudo Comparativo

    VI Workshop em Sistema Computacionais de Alto Desempenho, 2005

  • Loop-way Cache

    Workshop em Sistemas Computacionais de alto desempenho, 2005

  • IMPLEMENTAÇÃO DE UM COMPRESSOR DE CÓDIGO PARA MIPS

    CONGIC, 2005

  • LBGCACHE V2.0: SIMULADOR DIDÁTICO PARA ANÁLISE DO COMPORTAMENTO E FUNCIONAMENTO ESTRUTURAL DE MEMÓRIAS CACHE

    CONGIC, 2005

  • IMPLEMENTAÇÃO EM JAVA DE UM MONTADOR/LIGADOR/CARREGADOR PARA MIPS

    CONGIC, 2005

  • Multi-profile based code compression

    Design Automation Conference, 2004

  • Multi-profile Instrtuction Based Compression

    16th Symposium on Computer Architecture and High Performance Computing, 2004

  • Mixed Static/Dynamic Profiling for Dictionary Based Code Compression

    2003 International Symposium on System-on-Chip, 2003

  • Using RISCs on Digital Signal Processing

    VIII simpósio Brasileiro de Arquitetura de Computadores e Processamento de Alto desempenho, 1996

  • RISC Processor for Digital Signal Processing Purposes

    The Sixth International Conference on Digital Signal Processing Applications and Technology, 1995

Sincronizado em 28/11/2025 às 04:31 (há 23 horas, 51 minutos)